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模擬信號在時域上是連續的，因此可以將它轉換為時間上連續的一系列數字信號。這樣就要求定義一個參數來表示新的數字信號采樣自模擬信號速率。這個速率稱為轉換器的采樣率（samplingrate）或采樣頻率（samplingfrequency） [2]  。

可以采集連續變化、帶寬受限的信號（即每隔一時間測量并存儲一個信號值），然后可以通過插值將轉換后的離散信號還原為原始信號。這一過程的精確度受量化誤差的限制。然而，僅當采樣率比信號頻率的兩倍還高的情況下才可能達到對原始信號的忠實還原，這一規律在采樣定理有所體現 [2]  。

由于實際使用的模擬數字轉換器不能進行*實時的轉換，所以對輸入信號進行一次轉換的過程中必須通過一些外加方法使之保持恒定。常用的有采樣-保持電路，在大多數的情況里，通過使用一個電容器可以存儲輸入的模擬電壓，并通過開關或門電路來閉合、斷開這個電容和輸入信號的連接。許多模擬數字轉換集成電路在內部就已經包含了這樣的采樣-保持子系統。

1.儀表促進了更快的ADC速度和更多的通道數與密度，設計者必須評估轉換器的輸出格式，以及基本的轉換性能 [2]  。

2.主要的輸出選項是CMOS(互補金屬氧化物半導體)、LVDS(低壓差分信令)，以及CML(電流模式邏輯) [2]  。

3.要考慮的問題包括：功耗、瞬變、數據與時鐘的變形，以及對噪聲的抑制能力 [2]  。

4.對于布局的考慮也是轉換輸出選擇中的一個方面，尤其當采用LVDS技術時。 當設計者有多種ADC選擇時，他們必須考慮采用哪種類型的數字數據輸出：CMOS(互補金屬氧化物半導體)、LVDS(低壓差分信令)，還是CML(電流模式邏輯)。ADC中所采用的每種數字輸出類型都各有優缺點，設計者應結合自己的應用來考慮。這些因素取決于ADC的采樣速率與分辨率、輸出數據速率，以及系統設計的功率要求，等等